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- Mon Jan 13, 2020 1:52 am
- Forum: ESP-IDF 中文讨论版
- Topic: esp32 cache功能请教
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esp32 cache功能请教
ESP32 technique reference 中提到“当只有 PRO CPU 使用 Cache 或只有 APP CPU 使用 Cache 时,可以通过配置寄存器 DPORT_CACHE_MUX_MODE_REG 的 CACHE_MUX_MODE[1:0] 位,选择使用 Internal SRAM0的 POOL0 或 POOL1 作为 cache memory。当 PRO CPU 和 APP CPU 都使用 Cache 时, Internal SRAM0 的POOL0 和 POOL1 可以复用作为 cache memory。” 请问默认的SDK中有把“Internal SRAM0的POOL...
- Thu Jan 09, 2020 8:54 am
- Forum: ESP-IDF 中文讨论版
- Topic: esp32 CPU 240MHz, 为什么dhrystone测量值这么低?
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esp32 CPU 240MHz, 为什么dhrystone测量值这么低?
通过make menuconfig 把esp32 的CPU clock设置成240MHz, 分别把dhrystone的测试代码放到SRAM和flash执行,测量代码执行效率。
从文档来看,SRAM没有cache,flash有cache。
测试结果是,在SRAM和flash下的执行效率没多大差别,dhrystone只有0.67867DMIPS/Mz/S,只有240MHz理论值的1/2,,是SRAM和cache的速度太慢了吗?
我们最近在评估贵司的芯片,这样的结果显然达不到预期,可以请问一下具体原因吗?
从文档来看,SRAM没有cache,flash有cache。
测试结果是,在SRAM和flash下的执行效率没多大差别,dhrystone只有0.67867DMIPS/Mz/S,只有240MHz理论值的1/2,,是SRAM和cache的速度太慢了吗?
我们最近在评估贵司的芯片,这样的结果显然达不到预期,可以请问一下具体原因吗?